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By Steve Nelson (auth.), Hans-Werner Meuer (eds.)

"SUPERCOMPUTER `93 - Anwendungen, Architekturen, tendencies" enth{lt alle Vortr{ge des f}hrenden Seminars }ber dieses Fachgebiet im deutschsprachigen Raum. Der Band ist f}r Supercomputer-Anwender, -Betreiber und -Hersteller sowie f}r Entscheidungstr{ger und Planer im Bereich der Informationsverarbeitung ein untentbehrliches Hilfsmittel, um in diesem unerh|rt innovativen Gebiet Schritt halten zu k|nnen. Er versetzt dar}ber hinaus Informatiker aus Hochschulen und Forschungsinstituten in die Lage, existierende Probleme in der Supercomputer-Praxis besser verstehenund einordnen zu k|nnen.

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As are the packages AMBER. AVL-FIRE, CHARM. CTM. DATA. GAMESS. LISS. MOPAC. NASTRAN. PAFEC. PAM-CRASH and rendering modules from AVS. 44 8 System Performance CS-2 systems are scalable and highly ftexible. The modular architecture ensures that processing and I/O performance can be tailored precisely to individual requirements by combining each of the three types of processing element: Vector, SPARC and SPARC plusI/O. v V V V D I/O SWV V V V V V V V D SWV V V V Fig. 3. Schematic of 32 PE Vector CS-2 A CS-2 system with a base configuration of 4 scalar I/O and 32 vector processing elements would have the following structure and provide performance as indicated in the table below: Table 1.

Bemerkenswert ist auch, dafi hier die Geschwindigkeit gegenuber der Erde starker abnimmt als die gegenuber der bewegten Luft. In dem auf die Kurve folgenden Steigfiug, wiihrend dem die Geschwindigkeiten weiter abnehmen, bleibt die Geschwindigkeit gegenuber der Luft groBer als die gegenuber der Erde (Flug gegen den Wind). In der oberen Kurve, in der die Gesamtgeschwindigkeiten ihre kleinsten und die Rohe ihre groBten Werte erreichen, kehren sich die Geschwindigkeitsverhaltnisse urn. Hierbei tritt eine Beschieunigung gegenuber der Erde ein.

0' .. ~' ~ Register Other PEts ...... Global ) I 4'",,,.. Memory-Memo ry Transfer ~ Memory-Reglst er Transfer ... ', 'Who am 11', etc) Fig. 3 Execution Profile Fig. 6 depicts a typical execution profile of a parallelized codc. On the left column, L'1e sections of a code, A through H are shown together with L'1e compiler directives for parallelization. The right half of the figure illustrates the actions corresponding to the compiler directives. Example of Parallel Progr~m PE' PROCESSOR P (8) A PARALLEL REGION A Execution 4 : 5 6: 7 : 8 : r-~~~~~~~~~~-' B SPREAD REGION jP(1:2) C kEG10N jP(3:8) D END SPREAD E SPREAD DO j(P) DO 10 I=l,N F 10 CONTINUE END SPREAD G END PARALLEL H Fig.

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